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EP0308939A2 Expired / Lapsed EP ⏱️ 0.0 years remaining

Method of manufacturing a MESFET with self aligned gate

Assignee: Siemens AG
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Filing: 1988-09-22
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Granted: —
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Expires: 2008-09-22
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Abstract

Abstract Translated from German Verfahren zur Herstellung eines MESFET mit einem Gate, das sowohl bezüglich der Source- und Drain-Bereiche als auch bezüglich der zugehörigen Metallisierungen selbstjustiert ist, wobei nach Dotierung des Trägersubstrates (1) ganzflächig eine erste Metallschicht (21), eine erste Dielektrikumschicht (31) und eine erste Lackmaskenschicht (41,42) aufgebracht, durch anisotropes Ätzen (a) ein in der Dotierungsschicht (11) einen äußeren Rücksprung (11a) erzeugender Graben ausgebildet, eine zweite Dielektrikumschicht (32) isotrop abgeschieden und anisotrop bis auf Spacer (51,52) rückgeätzt, wobei in der Dotierungsschicht (11) ein innerer Rücksprung (11b) erzeugt wird (double recess), und schließlich das Gate-Metall (22) aufgebracht wird. Method for producing a MESFET with a gate which is self-aligned both with regard to the source and drain regions and with regard to the associated metallizations, with a first metal layer (21) and a first dielectric layer (31) covering the entire surface after doping of the carrier substrate (1) and a first resist mask layer (41, 42) is applied, anisotropic etching (a) forms a trench in the doping layer (11) producing an external recess (11a), a second dielectric layer (32) is isotropically deposited and anisotropically except for spacers (51, 52) etched back, an inner recess (11b) being produced in the doping layer (11) (double recess), and finally the gate metal (22) being applied.

Inventors

  • 👤 Josef Dr. Willer

Bibliographic Details

Application Number —
Jurisdiction EP
Data Source google_patents
Last Synchronized 2026-10-30 11:17
CPC Classifications
H; H10; H10D; H10D30/00; H10D30/01; H10D30/061; H10D30/0612; H10D64/00; H10D64/01; H10D64/012; H10D64/0124; H10D64/0125; Y; Y10; Y10S; Y10S148/00; Y10S148/139; Y10S148/14; Y10S148/168

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